飛利浦最新筆試題目分享

　　飛利浦推出的全新筆試題目：

　　1.用一個(gè)二選一mux和一個(gè)inv實(shí)現異或。

　　2.用邏輯門(mén)和cmos電路實(shí)現ab cd。

　　3.給了reg的setup和hold時(shí)間，求中間組合邏輯的delay范圍。

　　4.如何解決亞穩態(tài)。

　　5.用Verilog/VHDL寫(xiě)一個(gè)fifo控制器。

　　6.用Verilog/VDDL檢測stream中的特定字符串。

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