內存DDR3與DDR2的不同之處

　　DDR3內存相對于DDR2內存，其實(shí)只是規格上的提高，并沒(méi)有真正的全面換代的新架。下面是YJBYS小編整理的內存DDR3與DDR2的相關(guān)內容，希望對你有幫助!

　　1.突發(fā)長(cháng)度(Burst Length，BL)

　　由于DDR3的預取為8bit，所以突發(fā)傳輸周期(Burst Length，BL)也固定為8，而對于DDR2和早期的DDR架構系統，BL=4也是常用的，DDR3為此增加了一個(gè)4bit Burst Chop(突發(fā)突變)模式，即由一個(gè)BL=4的讀取操作加上一個(gè)BL=4的寫(xiě)入操作來(lái)合成一個(gè)BL=8的數據突發(fā)傳輸，屆時(shí)可通過(guò)A12地址線(xiàn)來(lái)控制這一突發(fā)模式。而且需要指出的是，任何突發(fā)中斷操作都將在DDR3內存中予以禁止，且不予支持，取而代之的是更靈活的突發(fā)傳輸控制(如4bit順序突發(fā))。

　　2.尋址時(shí)序(Timing)

　　就像DDR2從DDR轉變而來(lái)后延遲周期數增加一樣，DDR3的CL周期也將比DDR2有所提高。DDR2的CL范圍一般在2～5之間，而DDR3則在5～11之間，且附加延遲(AL)的設計也有所變化。DDR2時(shí)AL的范圍是0～4，而DDR3時(shí)AL有三種選項，分別是0、CL-1和CL-2。另外，DDR3還新增加了一個(gè)時(shí)序參數——寫(xiě)入延遲(CWD)，這一參數將根據具體的工作頻率而定。

　　3.DDR3新增的重置(Reset)功能

　　重置是DDR3新增的一項重要功能，并為此專(zhuān)門(mén)準備了一個(gè)引腳。DRAM業(yè)界很早以前就要求增加這一功能，如今終于在DDR3上實(shí)現了。這一引腳將使DDR3的初始化處理變得簡(jiǎn)單。當Reset命令有效時(shí)，DDR3內存將停止所有操作，并切換至最少量活動(dòng)狀態(tài)，以節約電力。

　　在Reset期間，DDR3內存將關(guān)閉內在的大部分功能，所有數據接收與發(fā)送器都將關(guān)閉，所有內部的程序裝置將復位，DLL(延遲鎖相環(huán)路)與時(shí)鐘電路將停止工作，而且不理睬數據總線(xiàn)上的任何動(dòng)靜。這樣一來(lái)，將使DDR3達到最節省電力的目的。

　　4.DDR3新增ZQ校準功能

　　ZQ也是一個(gè)新增的腳，在這個(gè)引腳上接有一個(gè)240歐姆的低公差參考電阻。這個(gè)引腳通過(guò)一個(gè)命令集，通過(guò)片上校準引擎(On-Die Calibration Engine，ODCE)來(lái)自動(dòng)校驗數據輸出驅動(dòng)器導通電阻與ODT的終結電阻值。當系統發(fā)出這一指令后，將用相應的時(shí)鐘周期(在加電與初始化之后用512個(gè)時(shí)鐘周期，在退出自刷新操作后用256個(gè)時(shí)鐘周期、在其他情況下用64個(gè)時(shí)鐘周期)對導通電阻和ODT電阻進(jìn)行重新校準。

　　5.參考電壓分成兩個(gè)

　　在DDR3系統中，對于內存系統工作非常重要的參考電壓信號VREF將分為兩個(gè)信號，即為命令與地址信號服務(wù)的VREFCA和為數據總線(xiàn)服務(wù)的VREFDQ，這將有效地提高系統數據總線(xiàn)的信噪等級。

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