基于SOPC的LMS自適應濾波算法實(shí)現

全部作者： 陳豐 陳禾 趙良畢 王勁松 第1作者單位： 北京郵電大學(xué)電信工程學(xué)院 論文摘要： 針對利用數字信號處理器(DSP)實(shí)現的自適應濾波器處理速度較低、抗干擾性差和編寫(xiě)底層HDL代碼用現場(chǎng)可編程門(mén)陣列FPGA實(shí)現開(kāi)發(fā)效率低的缺點(diǎn)，本文利用基于FPGA的SOPC硬件平臺實(shí)現了最小均方誤差(LMS)算法濾除信號中工頻噪聲成分的2階自適應濾波器，利用QuartusII中的SOPC Builder在FPGA系統中嵌入了NoisII軟核CPU，用于控制信號數據的存儲、傳輸以及FPGA-開(kāi)發(fā)板與PC計算機的通信，LMS算法的VHDL代碼由作為Matlab/Simulink工具箱的Altera DSP Builder中用可視化的方法直接生成 關(guān)鍵詞： SOPC 自適應濾波 LMS算法 嵌入式CPU FPGA (瀏覽全文) 發(fā)表日期： 2007年04月06日 同行評議：

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